[PATCH] m32r: framebuffer device support

+51 -4

arch/m32r/kernel/setup_m32700ut.c

··· 3 3 * 4 4 * Setup routines for Renesas M32700UT Board 5 5 * 6 - * Copyright (c) 2002 Hiroyuki Kondo, Hirokazu Takata, 7 - * Hitoshi Yamamoto, Takeo Takahashi 6 + * Copyright (c) 2002-2005 Hiroyuki Kondo, Hirokazu Takata, 7 + * Hitoshi Yamamoto, Takeo Takahashi 8 8 * 9 9 * This file is subject to the terms and conditions of the GNU General 10 10 * Public License. See the file "COPYING" in the main directory of this ··· 435 435 icu_data[M32R_IRQ_INT2].icucr = M32R_ICUCR_IEN|M32R_ICUCR_ISMOD01; 436 436 enable_m32700ut_irq(M32R_IRQ_INT2); 437 437 438 - //#if defined(CONFIG_VIDEO_M32R_AR) 438 + #if defined(CONFIG_VIDEO_M32R_AR) 439 439 /* 440 440 * INT3# is used for AR 441 441 */ ··· 445 445 irq_desc[M32R_IRQ_INT3].depth = 1; 446 446 icu_data[M32R_IRQ_INT3].icucr = M32R_ICUCR_IEN|M32R_ICUCR_ISMOD10; 447 447 disable_m32700ut_irq(M32R_IRQ_INT3); 448 - //#endif /* CONFIG_VIDEO_M32R_AR */ 448 + #endif /* CONFIG_VIDEO_M32R_AR */ 449 449 } 450 + 451 + #if defined(CONFIG_SMC91X) 450 452 451 453 #define LAN_IOSTART 0x300 452 454 #define LAN_IOEND 0x320 ··· 471 469 .num_resources = ARRAY_SIZE(smc91x_resources), 472 470 .resource = smc91x_resources, 473 471 }; 472 + #endif 473 + 474 + #if defined(CONFIG_FB_S1D13XXX) 475 + 476 + #include <video/s1d13xxxfb.h> 477 + #include <asm/s1d13806.h> 478 + 479 + static struct s1d13xxxfb_pdata s1d13xxxfb_data = { 480 + .initregs = s1d13xxxfb_initregs, 481 + .initregssize = ARRAY_SIZE(s1d13xxxfb_initregs), 482 + .platform_init_video = NULL, 483 + #ifdef CONFIG_PM 484 + .platform_suspend_video = NULL, 485 + .platform_resume_video = NULL, 486 + #endif 487 + }; 488 + 489 + static struct resource s1d13xxxfb_resources[] = { 490 + [0] = { 491 + .start = 0x10600000UL, 492 + .end = 0x1073FFFFUL, 493 + .flags = IORESOURCE_MEM, 494 + }, 495 + [1] = { 496 + .start = 0x10400000UL, 497 + .end = 0x104001FFUL, 498 + .flags = IORESOURCE_MEM, 499 + } 500 + }; 501 + 502 + static struct platform_device s1d13xxxfb_device = { 503 + .name = S1D_DEVICENAME, 504 + .id = 0, 505 + .dev = { 506 + .platform_data = &s1d13xxxfb_data, 507 + }, 508 + .num_resources = ARRAY_SIZE(s1d13xxxfb_resources), 509 + .resource = s1d13xxxfb_resources, 510 + }; 511 + #endif 474 512 475 513 static int __init platform_init(void) 476 514 { 515 + #if defined(CONFIG_SMC91X) 477 516 platform_device_register(&smc91x_device); 517 + #endif 518 + #if defined(CONFIG_FB_S1D13XXX) 519 + platform_device_register(&s1d13xxxfb_device); 520 + #endif 478 521 return 0; 479 522 } 480 523 arch_initcall(platform_init);

+49 -2

arch/m32r/kernel/setup_mappi.c

··· 3 3 * 4 4 * Setup routines for Renesas MAPPI Board 5 5 * 6 - * Copyright (c) 2001, 2002 Hiroyuki Kondo, Hirokazu Takata, 7 - * Hitoshi Yamamoto 6 + * Copyright (c) 2001-2005 Hiroyuki Kondo, Hirokazu Takata, 7 + * Hitoshi Yamamoto 8 8 */ 9 9 10 10 #include <linux/config.h> 11 11 #include <linux/irq.h> 12 12 #include <linux/kernel.h> 13 13 #include <linux/init.h> 14 + #include <linux/device.h> 14 15 15 16 #include <asm/system.h> 16 17 #include <asm/m32r.h> ··· 159 158 disable_mappi_irq(M32R_IRQ_INT2); 160 159 #endif /* CONFIG_M32RPCC */ 161 160 } 161 + 162 + #if defined(CONFIG_FB_S1D13XXX) 163 + 164 + #include <video/s1d13xxxfb.h> 165 + #include <asm/s1d13806.h> 166 + 167 + static struct s1d13xxxfb_pdata s1d13xxxfb_data = { 168 + .initregs = s1d13xxxfb_initregs, 169 + .initregssize = ARRAY_SIZE(s1d13xxxfb_initregs), 170 + .platform_init_video = NULL, 171 + #ifdef CONFIG_PM 172 + .platform_suspend_video = NULL, 173 + .platform_resume_video = NULL, 174 + #endif 175 + }; 176 + 177 + static struct resource s1d13xxxfb_resources[] = { 178 + [0] = { 179 + .start = 0x10200000UL, 180 + .end = 0x1033FFFFUL, 181 + .flags = IORESOURCE_MEM, 182 + }, 183 + [1] = { 184 + .start = 0x10000000UL, 185 + .end = 0x100001FFUL, 186 + .flags = IORESOURCE_MEM, 187 + } 188 + }; 189 + 190 + static struct platform_device s1d13xxxfb_device = { 191 + .name = S1D_DEVICENAME, 192 + .id = 0, 193 + .dev = { 194 + .platform_data = &s1d13xxxfb_data, 195 + }, 196 + .num_resources = ARRAY_SIZE(s1d13xxxfb_resources), 197 + .resource = s1d13xxxfb_resources, 198 + }; 199 + 200 + static int __init platform_init(void) 201 + { 202 + platform_device_register(&s1d13xxxfb_device); 203 + return 0; 204 + } 205 + arch_initcall(platform_init); 206 + #endif

+2 -2

arch/m32r/kernel/setup_mappi2.c

··· 3 3 * 4 4 * Setup routines for Renesas MAPPI-II(M3A-ZA36) Board 5 5 * 6 - * Copyright (c) 2001, 2002 Hiroyuki Kondo, Hirokazu Takata, 7 - * Hitoshi Yamamoto, Mamoru Sakugawa 6 + * Copyright (c) 2001-2005 Hiroyuki Kondo, Hirokazu Takata, 7 + * Hitoshi Yamamoto, Mamoru Sakugawa 8 8 */ 9 9 10 10 #include <linux/config.h>

+50 -2

arch/m32r/kernel/setup_mappi3.c

··· 3 3 * 4 4 * Setup routines for Renesas MAPPI-III(M3A-2170) Board 5 5 * 6 - * Copyright (c) 2001-2005 Hiroyuki Kondo, Hirokazu Takata, 7 - * Hitoshi Yamamoto, Mamoru Sakugawa 6 + * Copyright (c) 2001-2005 Hiroyuki Kondo, Hirokazu Takata, 7 + * Hitoshi Yamamoto, Mamoru Sakugawa 8 8 */ 9 9 10 10 #include <linux/config.h> ··· 178 178 #endif /* CONFIG_M32R_CFC */ 179 179 } 180 180 181 + #if defined(CONFIG_SMC91X) 182 + 181 183 #define LAN_IOSTART 0x300 182 184 #define LAN_IOEND 0x320 183 185 static struct resource smc91x_resources[] = { ··· 202 200 .resource = smc91x_resources, 203 201 }; 204 202 203 + #endif 204 + 205 + #if defined(CONFIG_FB_S1D13XXX) 206 + 207 + #include <video/s1d13xxxfb.h> 208 + #include <asm/s1d13806.h> 209 + 210 + static struct s1d13xxxfb_pdata s1d13xxxfb_data = { 211 + .initregs = s1d13xxxfb_initregs, 212 + .initregssize = ARRAY_SIZE(s1d13xxxfb_initregs), 213 + .platform_init_video = NULL, 214 + #ifdef CONFIG_PM 215 + .platform_suspend_video = NULL, 216 + .platform_resume_video = NULL, 217 + #endif 218 + }; 219 + 220 + static struct resource s1d13xxxfb_resources[] = { 221 + [0] = { 222 + .start = 0x1d600000UL, 223 + .end = 0x1d73FFFFUL, 224 + .flags = IORESOURCE_MEM, 225 + }, 226 + [1] = { 227 + .start = 0x1d400000UL, 228 + .end = 0x1d4001FFUL, 229 + .flags = IORESOURCE_MEM, 230 + } 231 + }; 232 + 233 + static struct platform_device s1d13xxxfb_device = { 234 + .name = S1D_DEVICENAME, 235 + .id = 0, 236 + .dev = { 237 + .platform_data = &s1d13xxxfb_data, 238 + }, 239 + .num_resources = ARRAY_SIZE(s1d13xxxfb_resources), 240 + .resource = s1d13xxxfb_resources, 241 + }; 242 + #endif 243 + 205 244 static int __init platform_init(void) 206 245 { 246 + #if defined(CONFIG_SMC91X) 207 247 platform_device_register(&smc91x_device); 248 + #endif 249 + #if defined(CONFIG_FB_S1D13XXX) 250 + platform_device_register(&s1d13xxxfb_device); 251 + #endif 208 252 return 0; 209 253 } 210 254 arch_initcall(platform_init);

+2 -3

arch/m32r/kernel/setup_oaks32r.c

··· 3 3 * 4 4 * Setup routines for OAKS32R Board 5 5 * 6 - * Copyright (c) 2002-2004 Hiroyuki Kondo, Hirokazu Takata, 7 - * Hitoshi Yamamoto, Mamoru Sakugawa 6 + * Copyright (c) 2002-2005 Hiroyuki Kondo, Hirokazu Takata, 7 + * Hitoshi Yamamoto, Mamoru Sakugawa 8 8 */ 9 9 10 10 #include <linux/config.h> ··· 139 139 icu_data[M32R_IRQ_SIO1_S].icucr = 0; 140 140 disable_oaks32r_irq(M32R_IRQ_SIO1_S); 141 141 #endif /* CONFIG_SERIAL_M32R_SIO */ 142 - 143 142 }

+50 -3

arch/m32r/kernel/setup_opsput.c

··· 3 3 * 4 4 * Setup routines for Renesas OPSPUT Board 5 5 * 6 - * Copyright (c) 2002-2004 6 + * Copyright (c) 2002-2005 7 7 * Hiroyuki Kondo, Hirokazu Takata, 8 8 * Hitoshi Yamamoto, Takeo Takahashi, Mamoru Sakugawa 9 9 * ··· 439 439 icu_data[M32R_IRQ_INT2].icucr = M32R_ICUCR_IEN|M32R_ICUCR_ISMOD01; 440 440 enable_opsput_irq(M32R_IRQ_INT2); 441 441 442 - //#if defined(CONFIG_VIDEO_M32R_AR) 442 + #if defined(CONFIG_VIDEO_M32R_AR) 443 443 /* 444 444 * INT3# is used for AR 445 445 */ ··· 449 449 irq_desc[M32R_IRQ_INT3].depth = 1; 450 450 icu_data[M32R_IRQ_INT3].icucr = M32R_ICUCR_IEN|M32R_ICUCR_ISMOD10; 451 451 disable_opsput_irq(M32R_IRQ_INT3); 452 - //#endif /* CONFIG_VIDEO_M32R_AR */ 452 + #endif /* CONFIG_VIDEO_M32R_AR */ 453 453 } 454 + 455 + #if defined(CONFIG_SMC91X) 454 456 455 457 #define LAN_IOSTART 0x300 456 458 #define LAN_IOEND 0x320 ··· 475 473 .num_resources = ARRAY_SIZE(smc91x_resources), 476 474 .resource = smc91x_resources, 477 475 }; 476 + #endif 477 + 478 + #if defined(CONFIG_FB_S1D13XXX) 479 + 480 + #include <video/s1d13xxxfb.h> 481 + #include <asm/s1d13806.h> 482 + 483 + static struct s1d13xxxfb_pdata s1d13xxxfb_data = { 484 + .initregs = s1d13xxxfb_initregs, 485 + .initregssize = ARRAY_SIZE(s1d13xxxfb_initregs), 486 + .platform_init_video = NULL, 487 + #ifdef CONFIG_PM 488 + .platform_suspend_video = NULL, 489 + .platform_resume_video = NULL, 490 + #endif 491 + }; 492 + 493 + static struct resource s1d13xxxfb_resources[] = { 494 + [0] = { 495 + .start = 0x10600000UL, 496 + .end = 0x1073FFFFUL, 497 + .flags = IORESOURCE_MEM, 498 + }, 499 + [1] = { 500 + .start = 0x10400000UL, 501 + .end = 0x104001FFUL, 502 + .flags = IORESOURCE_MEM, 503 + } 504 + }; 505 + 506 + static struct platform_device s1d13xxxfb_device = { 507 + .name = S1D_DEVICENAME, 508 + .id = 0, 509 + .dev = { 510 + .platform_data = &s1d13xxxfb_data, 511 + }, 512 + .num_resources = ARRAY_SIZE(s1d13xxxfb_resources), 513 + .resource = s1d13xxxfb_resources, 514 + }; 515 + #endif 478 516 479 517 static int __init platform_init(void) 480 518 { 519 + #if defined(CONFIG_SMC91X) 481 520 platform_device_register(&smc91x_device); 521 + #endif 522 + #if defined(CONFIG_FB_S1D13XXX) 523 + platform_device_register(&s1d13xxxfb_device); 524 + #endif 482 525 return 0; 483 526 } 484 527 arch_initcall(platform_init);

+5

drivers/video/logo/Kconfig

··· 63 63 depends on LOGO && SUPERH 64 64 default y 65 65 66 + config LOGO_M32R_CLUT224 67 + bool "224-color M32R Linux logo" 68 + depends on LOGO && M32R 69 + default y 70 + 66 71 endmenu 67 72

+1

drivers/video/logo/Makefile

··· 12 12 obj-$(CONFIG_LOGO_SUPERH_MONO) += logo_superh_mono.o 13 13 obj-$(CONFIG_LOGO_SUPERH_VGA16) += logo_superh_vga16.o 14 14 obj-$(CONFIG_LOGO_SUPERH_CLUT224) += logo_superh_clut224.o 15 + obj-$(CONFIG_LOGO_M32R_CLUT224) += logo_m32r_clut224.o 15 16 16 17 # How to generate logo's 17 18

+5

drivers/video/logo/logo.c

··· 33 33 extern const struct linux_logo logo_superh_mono; 34 34 extern const struct linux_logo logo_superh_vga16; 35 35 extern const struct linux_logo logo_superh_clut224; 36 + extern const struct linux_logo logo_m32r_clut224; 36 37 37 38 38 39 const struct linux_logo *fb_find_logo(int depth) ··· 97 96 #ifdef CONFIG_LOGO_SUPERH_CLUT224 98 97 /* SuperH Linux logo */ 99 98 logo = &logo_superh_clut224; 99 + #endif 100 + #ifdef CONFIG_LOGO_M32R_CLUT224 101 + /* M32R Linux logo */ 102 + logo = &logo_m32r_clut224; 100 103 #endif 101 104 } 102 105 return logo;

+1292

drivers/video/logo/logo_m32r_clut224.ppm

··· 1 + P3 2 + # CREATOR: The GIMP's PNM Filter Version 1.0 3 + # 4 + # Note: how to convert ppm to pnm(ascii). 5 + # $ convert -posterize 224 m32r.ppm - | pnm2asc -f5 >logo_m32r_clut224.ppm 6 + # 7 + # convert - imagemagick: /usr/bin/convert 8 + # pnm2asc - pnm to ascii-pnm format converter 9 + # http://www.is.aist.go.jp/etlcdb/util/p2a.htm#English 10 + 11 + 80 80 12 + 255 13 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 14 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 15 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 16 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 17 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 18 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 19 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 20 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 21 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 22 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 23 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 24 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 25 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 26 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 27 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 28 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 29 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 30 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 31 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 32 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 33 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 34 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 35 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 36 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 37 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 38 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 39 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 40 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 41 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 42 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 43 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 44 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 45 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 46 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 47 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 48 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 49 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 50 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 51 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 52 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 53 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 54 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 55 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 56 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 57 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 58 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 59 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 60 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 61 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 62 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 63 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 64 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 65 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 66 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 67 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 68 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 69 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 70 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 71 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 72 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 73 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 74 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 75 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 76 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 77 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 78 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 79 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 80 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 81 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 82 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 83 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 84 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 85 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 86 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 87 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 88 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 89 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 90 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 91 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 92 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 93 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 94 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 95 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 96 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 97 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 98 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 99 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 100 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 101 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 102 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 103 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 104 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 105 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 106 + 215 150 13 215 150 13 215 150 13 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215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1265 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1266 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1267 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1268 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1269 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1270 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1271 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1272 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1273 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1274 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1275 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1276 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1277 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1278 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1279 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1280 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1281 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1282 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1283 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1284 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1285 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1286 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1287 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1288 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1289 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1290 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1291 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13 1292 + 215 150 13 215 150 13 215 150 13 215 150 13 215 150 13

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drivers/video/s1d13xxxfb.c

··· 67 67 static inline u8 68 68 s1d13xxxfb_readreg(struct s1d13xxxfb_par *par, u16 regno) 69 69 { 70 + #if defined(CONFIG_PLAT_M32700UT) || defined(CONFIG_PLAT_OPSPUT) || defined(CONFIG_PLAT_MAPPI3) 71 + regno=((regno & 1) ? (regno & ~1L) : (regno + 1)); 72 + #endif 70 73 return readb(par->regs + regno); 71 74 } 72 75 73 76 static inline void 74 77 s1d13xxxfb_writereg(struct s1d13xxxfb_par *par, u16 regno, u8 value) 75 78 { 79 + #if defined(CONFIG_PLAT_M32700UT) || defined(CONFIG_PLAT_OPSPUT) || defined(CONFIG_PLAT_MAPPI3) 80 + regno=((regno & 1) ? (regno & ~1L) : (regno + 1)); 81 + #endif 76 82 writeb(value, par->regs + regno); 77 83 } 78 84 ··· 265 259 dbg("s1d13xxxfb_setcolreg: pseudo %d, val %08x\n", 266 260 regno, pseudo_val); 267 261 262 + #if defined(CONFIG_PLAT_MAPPI) 263 + ((u32 *)info->pseudo_palette)[regno] = cpu_to_le16(pseudo_val); 264 + #else 268 265 ((u32 *)info->pseudo_palette)[regno] = pseudo_val; 266 + #endif 269 267 270 268 break; 271 269 case FB_VISUAL_PSEUDOCOLOR:

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include/asm-m32r/s1d13806.h

··· 1 + //---------------------------------------------------------------------------- 2 + // 3 + // File generated by S1D13806CFG.EXE 4 + // 5 + // Copyright (c) 2000,2001 Epson Research and Development, Inc. 6 + // All rights reserved. 7 + // 8 + //---------------------------------------------------------------------------- 9 + 10 + // Panel: (active) 640x480 77Hz STN Single 8-bit (PCLK=CLKI=25.175MHz) 11 + // Memory: Embedded SDRAM (MCLK=CLKI3=50.000MHz) (BUSCLK=33.333MHz) 12 + 13 + #define SWIVEL_VIEW 0 /* 0:none, 1:90 not completed */ 14 + 15 + static struct s1d13xxxfb_regval s1d13xxxfb_initregs[] = { 16 + 17 + {0x0001,0x00}, // Miscellaneous Register 18 + {0x01FC,0x00}, // Display Mode Register 19 + #if defined(CONFIG_PLAT_MAPPI) 20 + {0x0004,0x00}, // General IO Pins Configuration Register 0 21 + {0x0005,0x00}, // General IO Pins Configuration Register 1 22 + {0x0008,0x00}, // General IO Pins Control Register 0 23 + {0x0009,0x00}, // General IO Pins Control Register 1 24 + {0x0010,0x00}, // Memory Clock Configuration Register 25 + {0x0014,0x00}, // LCD Pixel Clock Configuration Register 26 + {0x0018,0x00}, // CRT/TV Pixel Clock Configuration Register 27 + {0x001C,0x00}, // MediaPlug Clock Configuration Register 28 + /* 29 + * .. 10MHz: 0x00 30 + * .. 30MHz: 0x01 31 + * 30MHz ..: 0x02 32 + */ 33 + {0x001E,0x02}, // CPU To Memory Wait State Select Register 34 + {0x0021,0x02}, // DRAM Refresh Rate Register 35 + {0x002A,0x11}, // DRAM Timings Control Register 0 36 + {0x002B,0x13}, // DRAM Timings Control Register 1 37 + {0x0020,0x80}, // Memory Configuration Register 38 + {0x0030,0x25}, // Panel Type Register 39 + {0x0031,0x00}, // MOD Rate Register 40 + {0x0032,0x4F}, // LCD Horizontal Display Width Register 41 + {0x0034,0x12}, // LCD Horizontal Non-Display Period Register 42 + {0x0035,0x01}, // TFT FPLINE Start Position Register 43 + {0x0036,0x0B}, // TFT FPLINE Pulse Width Register 44 + {0x0038,0xDF}, // LCD Vertical Display Height Register 0 45 + {0x0039,0x01}, // LCD Vertical Display Height Register 1 46 + {0x003A,0x2C}, // LCD Vertical Non-Display Period Register 47 + {0x003B,0x0A}, // TFT FPFRAME Start Position Register 48 + {0x003C,0x01}, // TFT FPFRAME Pulse Width Register 49 + 50 + {0x0041,0x00}, // LCD Miscellaneous Register 51 + {0x0042,0x00}, // LCD Display Start Address Register 0 52 + {0x0043,0x00}, // LCD Display Start Address Register 1 53 + {0x0044,0x00}, // LCD Display Start Address Register 2 54 + 55 + #elif defined(CONFIG_PLAT_M32700UT) || defined(CONFIG_PLAT_OPSPUT) || defined(CONFIG_PLAT_MAPPI3) 56 + {0x0004,0x07}, // GPIO[0:7] direction 57 + {0x0005,0x00}, // GPIO[8:12] direction 58 + {0x0008,0x00}, // GPIO[0:7] data 59 + {0x0009,0x00}, // GPIO[8:12] data 60 + {0x0008,0x04}, // LCD panel Vcc on 61 + {0x0008,0x05}, // LCD panel reset 62 + {0x0010,0x01}, // Memory Clock Configuration Register 63 + {0x0014,0x30}, // LCD Pixel Clock Configuration Register (CLKI 22MHz/4) 64 + {0x0018,0x00}, // CRT/TV Pixel Clock Configuration Register 65 + {0x001C,0x00}, // MediaPlug Clock Configuration Register(10MHz) 66 + {0x001E,0x00}, // CPU To Memory Wait State Select Register 67 + {0x0020,0x80}, // Memory Configuration Register 68 + {0x0021,0x03}, // DRAM Refresh Rate Register 69 + {0x002A,0x00}, // DRAM Timings Control Register 0 70 + {0x002B,0x01}, // DRAM Timings Control Register 1 71 + {0x0030,0x25}, // Panel Type Register 72 + {0x0031,0x00}, // MOD Rate Register 73 + {0x0032,0x1d}, // LCD Horizontal Display Width Register 74 + {0x0034,0x05}, // LCD Horizontal Non-Display Period Register 75 + {0x0035,0x01}, // TFT FPLINE Start Position Register 76 + {0x0036,0x01}, // TFT FPLINE Pulse Width Register 77 + {0x0038,0x3F}, // LCD Vertical Display Height Register 0 78 + {0x0039,0x01}, // LCD Vertical Display Height Register 1 79 + {0x003A,0x0b}, // LCD Vertical Non-Display Period Register 80 + {0x003B,0x07}, // TFT FPFRAME Start Position Register 81 + {0x003C,0x02}, // TFT FPFRAME Pulse Width Register 82 + 83 + {0x0041,0x00}, // LCD Miscellaneous Register 84 + #if (SWIVEL_VIEW == 0) 85 + {0x0042,0x00}, // LCD Display Start Address Register 0 86 + {0x0043,0x00}, // LCD Display Start Address Register 1 87 + {0x0044,0x00}, // LCD Display Start Address Register 2 88 + 89 + #elif (SWIVEL_VIEW == 1) 90 + // 1024 - W(320) = 0x2C0 91 + {0x0042,0xC0}, // LCD Display Start Address Register 0 92 + {0x0043,0x02}, // LCD Display Start Address Register 1 93 + {0x0044,0x00}, // LCD Display Start Address Register 2 94 + // 1024 95 + {0x0046,0x00}, // LCD Memory Address Offset Register 0 96 + {0x0047,0x02}, // LCD Memory Address Offset Register 1 97 + #else 98 + #error unsupported SWIVEL_VIEW mode 99 + #endif 100 + #else 101 + #error no platform configuration 102 + #endif /* CONFIG_PLAT_XXX */ 103 + 104 + {0x0048,0x00}, // LCD Pixel Panning Register 105 + {0x004A,0x00}, // LCD Display FIFO High Threshold Control Register 106 + {0x004B,0x00}, // LCD Display FIFO Low Threshold Control Register 107 + {0x0050,0x4F}, // CRT/TV Horizontal Display Width Register 108 + {0x0052,0x13}, // CRT/TV Horizontal Non-Display Period Register 109 + {0x0053,0x01}, // CRT/TV HRTC Start Position Register 110 + {0x0054,0x0B}, // CRT/TV HRTC Pulse Width Register 111 + {0x0056,0xDF}, // CRT/TV Vertical Display Height Register 0 112 + {0x0057,0x01}, // CRT/TV Vertical Display Height Register 1 113 + {0x0058,0x2B}, // CRT/TV Vertical Non-Display Period Register 114 + {0x0059,0x09}, // CRT/TV VRTC Start Position Register 115 + {0x005A,0x01}, // CRT/TV VRTC Pulse Width Register 116 + {0x005B,0x10}, // TV Output Control Register 117 + 118 + {0x0062,0x00}, // CRT/TV Display Start Address Register 0 119 + {0x0063,0x00}, // CRT/TV Display Start Address Register 1 120 + {0x0064,0x00}, // CRT/TV Display Start Address Register 2 121 + 122 + {0x0068,0x00}, // CRT/TV Pixel Panning Register 123 + {0x006A,0x00}, // CRT/TV Display FIFO High Threshold Control Register 124 + {0x006B,0x00}, // CRT/TV Display FIFO Low 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